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过去FPGA在系统中的定位，主要是协助ASIC、ASSP等核心处理器来处理数据、提供I/O扩充等功能，其定位是配角;但当走入28奈米，甚至是20奈米制程之后，FPGA可突破以往功耗过高的问题，成为高性能、低功耗以及小尺寸的代名词，而不再是配角。
赛灵思在努力向智能的系统解决方案提供商转型，Smarter Network 和 Smarter Vision正是这种转型之作，此外通过引入更强大的设计平台Vivado，让客户的产品设计可以更轻松的实现。
中国北京，2013年4月8日—— All Programmable技术和器件的全球领先企业赛灵思公司(Xilinx， Inc. (NASDAQ:XLNX) )今天宣布， 其业界首款可编程SoC级增强型Vivado™设计套件的最新版本在生产力方面进行了两大改进。Vivado设计套件2013.1版本新增了一款以IP为中心的设计环境，用以加速系统集成;而其提供的一套完整数据库，则可加速C/C
Xilinx公司宣布了两个主要的生产力的发展作为一种新的主要版本的Vivado设计套件，可编程行业的第一个soc强度设计套件。2013.1版本的Vivado设计套件包括一个新的ip为中心的设计环境，加速时间系统集成和一组全面的图书馆加速C / c++的系统级设计和高级合成(HLS)。
Xilinx 不久前正式公开了其20 nm产品路线图，在之前的28nm产品上，Xilinx声称他们领先竞争对手一代，落实了All Programmable器件战略(FPGA、SoC和3D IC)，推出了Vivado设计环境和开发套件，结合其丰富的IP资源，为市场提供了高性能、低功耗和有利于减少系统/BOM成本的产品。赛灵思公司全球高级副总裁，亚太区执行总裁汤立人表示，Xilinx在20nm产品的表
All Programmable技术和器件的领先企业赛灵思公司今天宣布推出Vivado设计套件的WebPACK版本，使设计人员能够立即免费获得业界首款SoC级的设计环境的器件专用版。WebPACK版本随Vivado设计套件2012.4版的发布而推出，可提供与Vivado设计套件设计版本相同的以IP和系统为中心的设计流程，集成和实现速度比其它可选方案快4倍之多。
All Programmable技术和器件的全球领先企业赛灵思公司(Xilinx， Inc. (NASDAQ:XLNX) )日前宣布推出Vivado设计套件的WebPACK版本，使设计人员能够立即免费获得业界首款SoC级的设计环境的器件专用版。
11月5日，在赛灵思媒体见面会上，赛灵思公司全球高级副总裁，亚太区执行总裁汤立人分享了Xilinx 继续领先一代的20nm 产品战略，“此外，下一代FPGA及第二代SoC和3D IC将与Vivado设计套件‘协同优化’，为行业提供最具吸引力的ASIC和ASSP可编程替代方案。”
自从四年前赛灵思开始 Vivado 设计套件的开发工作以来，就一直与数百家赛灵思联盟计划成员和客户保持密切联系，力求让新发布的工具达到成熟状态。每个成员都发挥了积极作用，确保赛灵思能够推出一款真正提高生产力的工具套件，帮助客户突破在新一代“All Programmable” 器件设计过程中所面临的集成和实现瓶颈。以下是客户对 Vivado 设计套件的评价。
集成的设计环境——Vivado 设计套件包括高度集成的设计环境和新一代系统到 IC 级工具，这些均建立在共享的可扩展数据模型和通用调试环境基础上。这也是一个基于 AMBA AXI4 互联规范、IP-XACT IP 封装元数据、工具命令语言 (TCL)、Synopsys 系统约束 (SDC) 以及其它有助于根据客户需求量身定制设计流程并符合业界标准的开放式环境。赛灵思构建的的 Vivado 工具将各
