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ADF4151的RF带宽达3.5 GHz，支持实现小数N分频或整数N分频PLL频率合成器。它由低噪声数字鉴频鉴相器(PFD)、精密电荷泵和可编程参考分频器组成，与已得到广泛应用的ADI ADF4350 4.4 GHz PLL引脚兼容且软件兼容。这两个PLL一起使用时，ADF4151支持使用外部压控振荡器(VCO)，无需对电路板进行较大改动便可大幅改善相位噪声性能。
本设计是纯数字电路的电子钟装置。由555定时器产生1kHz的信号，经分频器后获得1Hz的标准信号，这个信号直接决定了电子钟的走时是否准确。秒计数器、分计数器都是由74LS90和74LS161设计的60进制计敷器。小时计数器是由74LS90设计的24进制计数器。因为计数初始时间和标准时间不一致，所以电路中还设计有校时电路。本设计还可以附加扩展电路，比如报时电路、显示日期。
