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新思科技有限公司日前宣布：推出基于全新VIPER架构的DiscoveryTM 系列验证知识产权(Verification IP，简称VIP)。它完全采用SystemVerilog语言编写，并对UVM、VMM和OVM方法学提供原生性支持;因此Discovery VIP为加快并简化最复杂系统级芯片(SoC)设计的验证工作提供了内在性能、易用性及可扩展性。
全球领先的半导体设计、验证和制造软件及知识产权(IP)供应商新思科技有限公司日前宣布：即日起推出面向多种180纳米工艺技术的DesignWare® AEON®非易失性存储器(NVM)知识产权(IP)。
灿芯半导体与新思科技有限公司(Synopsys， Inc.，)及中芯国际深度合作，使灿芯自主研发的40nm芯片一次性流片成功。这颗芯片集成了Synopsys DesignWare® 嵌入式存储器和逻辑库，以及中芯国际自主研发的PLL、I/O等关键IP部件，成功验证了灿芯半导体在40nm工艺线上的前端和后端设计流程。
灿芯半导体与新思科技有限公司(Synopsys， Inc.，)及中芯国际深度合作，使灿芯自主研发的 40nm 芯片一次性流片成功。这颗芯片集成了 Synopsys DesignWare? 嵌入式存储器和逻辑库，以及中芯国际自主研发的 PLL、I/O 等关键 IP 部件，成功验证了灿芯半导体在 40nm 工艺线上的前端和后端设计流程。
全球领先的半导体设计、验证和制造软件及知识产权(IP)供应商新思科技有限公司(Synopsys， Inc.， 纳斯达克股票市场代码：SNPS)日前宣布，北京集成电路设计园与新思科技的合作进一步深化，达成了新的合作框架协议。
全球领先的半导体设计、验证和制造软件及知识产权(IP)供应商新思科技有限公司日前宣布推出动态解析度自适应(DRA)解码器软件的优化版本，主要面向已广泛应用的DesignWare® ARC™ Sound AS211SFX 和 各种AS221BD 音频处理器。
全球领先的半导体设计、验证和制造软件及知识产权(IP)供应商新思科技有限公司，以及中国大陆领先的IC代工服务供应商上海华虹NEC电子有限公司(HHNEC)今日宣布：即日起推出130纳米参考流程版本3.0。
全球领先的半导体设计、验证和制造软件及知识产权(IP)供应商新思科技有限公司日前宣布：该公司所提供经芯片生产验证的DesignWareTM数据转换器IP，已被应用于中芯国际广受欢迎的65纳米低漏电(Low Leakage)工艺技术。
全球领先的半导体设计、验证、和制造软件及知识产权 (IP) 的供应商新思科技有限公司和中芯国际集成电路制造有限公司（中芯国际）今天宣布已正式提供用于中芯国际先进65-nm 工艺的系统级芯片 (SoC) 综合设计解决方案。该解决方案将 Synopsys 丰富的 DesignWare® 接口、模拟 IP 产品组合和其他基础性 IP，通过可调参考流程与 Galaxy™ 实现平台集成在
新思科技有限公司日前宣布：英飞凌科技（西安）有限公司通过采用新思完整的、基于统一功率格式（UPF）的低功耗综合、物理实现和验证流程，完成了国内首款采用40nm工艺技术的3G智能手机基带处理器设计，并按照时间计划成功实现一次流片成功。
